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Dissertação (Mestrado)
Chipcflow - validação e implementação do modelo de partição e protocolo de comunicação no grafo a fluxo de dados dinâmico (2011)
Souza Júnior, Francisco de; Silva, Jorge Luiz e (Orientador)
Unidade: ICMC
Subjects: COMPUTAÇÃO RECONFIGURÁVEL, HARDWARE, ARQUITETURAS PARALELAS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SOUZA JÚNIOR, Francisco de. Chipcflow - validação e implementação do modelo de partição e protocolo de comunicação no grafo a fluxo de dados dinâmico. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25022011-111903/. Acesso em: 26 maio 2024.
APA
Souza Júnior, F. de. (2011). Chipcflow - validação e implementação do modelo de partição e protocolo de comunicação no grafo a fluxo de dados dinâmico (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25022011-111903/
NLM
Souza Júnior F de. Chipcflow - validação e implementação do modelo de partição e protocolo de comunicação no grafo a fluxo de dados dinâmico [Internet]. 2011 ;[citado 2024 maio 26 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25022011-111903/
Vancouver
Souza Júnior F de. Chipcflow - validação e implementação do modelo de partição e protocolo de comunicação no grafo a fluxo de dados dinâmico [Internet]. 2011 ;[citado 2024 maio 26 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25022011-111903/
Trabalho de evento
Research and partial analysis of overhead of a partition model for a partially reconfigurable hardware in a data-driven machine-chicflow (2010)
Souza Júnior, Francisco de; Silva, Jorge Luiz e; Sanches, Lucas; Astolfi, Vitor
Source: Proceedings. Conference titles: Southern Programmable Logic Conference - SPL. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, SISTEMAS ESPECIALISTAS, ROBÓTICA
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ABNT
SOUZA JÚNIOR, Francisco de et al. Research and partial analysis of overhead of a partition model for a partially reconfigurable hardware in a data-driven machine-chicflow. 2010, Anais.. Piscataway: IEEE, 2010. Disponível em: https://doi.org/10.1109/SPL.2010.5483013. Acesso em: 26 maio 2024.
APA
Souza Júnior, F. de, Silva, J. L. e, Sanches, L., & Astolfi, V. (2010). Research and partial analysis of overhead of a partition model for a partially reconfigurable hardware in a data-driven machine-chicflow. In Proceedings. Piscataway: IEEE. doi:10.1109/SPL.2010.5483013
NLM
Souza Júnior F de, Silva JL e, Sanches L, Astolfi V. Research and partial analysis of overhead of a partition model for a partially reconfigurable hardware in a data-driven machine-chicflow [Internet]. Proceedings. 2010 ;[citado 2024 maio 26 ] Available from: https://doi.org/10.1109/SPL.2010.5483013
Vancouver
Souza Júnior F de, Silva JL e, Sanches L, Astolfi V. Research and partial analysis of overhead of a partition model for a partially reconfigurable hardware in a data-driven machine-chicflow [Internet]. Proceedings. 2010 ;[citado 2024 maio 26 ] Available from: https://doi.org/10.1109/SPL.2010.5483013

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